No Altium Designer 14.3, estou tentando mesclar dois barramentos de 16 bits em um de 32 bits, com um dos barramentos de entrada se tornando os 16 bits mais baixos e o outro os 16 bits superiores do barramento de saída. Abaixo está uma imagem se meu método foi tentado.
Quando tento compilar o documento que receber o seguinte erro: Duplicate Net Names Bus Slice \Y[31..0]. Entendo como Altium pensa que estou tentando redefinir a \Yrede, mas não vejo uma maneira melhor de mesclar os dois barramentos, a não ser quebrar todos os pinos dos dois barramentos separados e fundi-los. É assim que eu faria o design se fosse um esquema FPGA HDL.
Como devo fazer isso?
schematics
altium
bus
secretformula
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Respostas:
Encontrei o mesmo problema e resolvi-o alterando o nome da rede local na sub-folha para que não corresponda ao nome da porta. Abaixo está um exemplo do que eu fiz:
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